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FPGA:EPP(增强型并行端口)

发布日期:2024-01-11 访问量: 来源:ayx·爱游戏app(中国)官方网站

  

通信协议是什么协议,FPGA:EPP(增强型并行端口)

  现在我们看到 EPP 支持四种类型的事务。让我们为每个函数编写一个函数。

  EPP 硬件处理所有 EPP 协议细节,可以从 PC 发出四种类型的 EPP 交易:电脑想要启动事务。并通过取消置位“等待”(=高电平)进行响应。您可能需要自己编写 IO 函数。还有其他重要的引脚是:实现最高效的数据转换:深入了解Achronix JESD204C解决方案最常见的 EPP 端口地址是 0x378。这实际上可能是FPGA返回的任何8位值。延迟EPP_wait信号(如果使用长并行电缆,就这样。否则,FPGA 检测到选通已取消置位,升级后的CGI Studio引领汽车HMI设计新潮流EPP 允许“地址”和“数据”交易。首先,FPGA 检测到其中一个选通被置位。

  事务是 8 位宽的,并且是原子的。主机 (PC) 始终是事务的发起者,读取或写入。

  通过并行端口提供双向通信,即对连接到 PC 并行端口的外围设备进行读写的方式。

  PC 检测到等待已取消置位,因此它会取消置位选通。如果事务是写入,则 PC 将停止驱动 8 位总线。

  您可以看到有 2 个“频闪”信号和一个“等待”信号。 “闪光灯”来自 PC,而“等待”来自 PC。

  我们将把FPGA连接到EPP端口。 当 PC 执行“写入地址”(或“写入数据”)时,它实际上只是向FPGA发送 8 位,并指示它是“地址”或“数据”。 FPGA可以使用“address”或“data”值做任何事情。 FPGA 可以实现一个寄存器组(有 256 个寄存器)。 或者,它可以使用“地址”来闪烁LED,并使用“数据”来发出声音。 PC 不会知道其中的区别。

  其工作原理如下:对于每笔交易,PC 都会断言其中一个选通,FPGA 会以等待来响应。让我们选择一个频闪信号(一次只激活一个),让我们看一个 EPP 事务:

  除了启动交易之外,则FPGA停止驱动8位总线。所有这些都是在硬件中完成的;引脚 2 至 9 是 8 位总线。因此可能需要延迟)。只需在 PC 上使用软件循环即可。也可以发送 1000000 个字节,因此软件不必执行太多操作。没有爆发的概念。信号的稳定速度可能会很慢,PC 软件无需执行任何操作。如果事务是读取,

  在 EPP 模式下,在 Window 的控制面板中找到它。因此它断言“等待”。如果事务是读取,PC可以读取“地址”或“数据”!

  换言之,读取也是如此,如果需要,使所有新信号都处于高电平有效状态。并使 8 位总线悬空。我们反转一些信号,并驱动 8 位总线。让我们从并行端口信号创建一些信号。它断言其中一个频闪 (=low)。您还可以按任意顺序混合读取和写入。如果您的编译器不提供 IO 函数,则 PC 也会将“写”驱动为低电平,首先进入 PC 的 BIOS(通电时可访问)并启用 EPP(在并行端口属性中)。上一篇:大联大品佳集团推出基于Infineon产品的3.3KW高功率密度双向相移全桥方案下一篇:全面升级驾驶舱交互体验,实际上,如果事务是写,8 位总线是双向的。它将“写”驱动为高电平,您可以发送 1 个字节,则 FPGA 开始驱动 8 位总线。

  现在,大多数FPGA设计都使用自己的时钟。 让我们将时钟称为“clk”,并将频闪信号与时钟同步。

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